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預覽 FPGA學習-例解阻塞賦值與非阻塞賦值	uid:108531 2016-3-12 22:34	06379	2016-3-12 22:34
預覽 FPGA學習-按鍵消抖模塊設計與驗證A	uid:108531 2016-3-12 22:30	08562	2016-3-12 22:30
預覽 FPGA學習–串口發送模塊與驗證	uid:108531 2016-3-12 22:12	05130	2016-3-12 22:12
預覽關于FPGA學習過程中的tcl文件與qsf文件	uid:104126 2016-1-23 00:13	15191	2016-3-11 23:43
預覽 FPGA數碼管交換顯示報錯	uid:262 2016-3-11 21:11	02555	2016-3-11 21:11
預覽 Verilog中阻塞賦值和非阻塞賦值的正確使用	uid:72008 2015-1-12 02:10	14244	2016-3-7 22:44
預覽 SOPC中自定義元件的端口設置解析	uid:107189 2016-3-4 20:44	04125	2016-3-4 20:44
預覽 FPGA學習之--如何在Quartus II 中調用Modelsim SE進行仿真調試	uid:105323 2016-3-4 01:29	07204	2016-3-4 01:29
預覽 FPGA學習之引腳分配	uid:105323 2016-3-4 01:28	03739	2016-3-4 01:28
預覽 FPGA學習之嵌入式鎖相環模塊ALTPLL的配置和調用	uid:105323 2016-3-4 01:28	06298	2016-3-4 01:28
預覽 verilog中`timescale的定義與作用	uid:105323 2016-2-23 17:45	05885	2016-2-23 17:45
預覽串口模塊	uid:105323 2016-2-23 17:44	03127	2016-2-23 17:44
預覽 reg型和memory型數據	uid:105323 2016-2-23 17:42	04302	2016-2-23 17:42
預覽兩儀性與多義性的問題	uid:105323 2016-2-23 17:41	02493	2016-2-23 17:41
預覽 verilog HDL中wire和reg的區別	uid:105323 2016-2-23 17:39	04658	2016-2-23 17:39
預覽 FPGA基礎知識及其工作原理	uid:105323 2016-2-23 04:07	13178	2016-2-23 13:00
預覽 Quartus II常見錯誤	uid:105323 2016-2-23 04:05	08607	2016-2-23 04:05
預覽 SOPC自定義外設	uid:105323 2016-2-23 04:03	02454	2016-2-23 04:03
預覽 signaltap使用簡記	uid:105323 2016-2-23 04:02	014529	2016-2-23 04:02
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預覽 DMA控制器使用	uid:105323 2016-2-23 03:59	02726	2016-2-23 03:59
預覽在Quartus中利用SOPC Builder做總線仲裁	uid:105323 2016-2-23 03:58	03394	2016-2-23 03:58
預覽自定義外設	uid:105323 2016-2-23 03:56	02533	2016-2-23 03:56
預覽 verilog綜合小結	uid:105323 2016-2-23 03:54	02384	2016-2-23 03:54
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預覽如何以32 bit的方式存取SDRAM	uid:105323 2016-2-23 03:35	04705	2016-2-23 03:35
預覽 Avalon-MM接口中waitrequest信號的實現	uid:105323 2016-2-23 03:34	05054	2016-2-23 03:34
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