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跪求NRF24L01收發(fā)程序，分開的

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樓主
ID:78515 發(fā)表于 2015-6-30 15:05 | 只看該作者
一般的2.4G模塊廠家都提供例程文件，買模塊最好找一家專業(yè)的有技術(shù)支持的公司，就算貴點(diǎn)學(xué)到知識(shí)也值得，買來(lái)無(wú)技術(shù)支持很難應(yīng)用的。我們公司專業(yè)研發(fā)無(wú)線模塊，有2.4G的收發(fā)例程文件。安陽(yáng)市新世紀(jì)電子研究所 需要聯(lián)系我吧，QQ2376726675
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ID:144022 發(fā)表于 2016-11-1 23:34 | 只看該作者
我也在研究，好難玩啊
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板凳
ID:150002 發(fā)表于 2016-11-24 20:55 | 只看該作者
快被整死了
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地板
ID:400885 發(fā)表于 2018-9-21 10:52 | 只看該作者
  1. #include <reg51.h>
  2. #define uchar unsigned char
  3. #define uint unsigned int
  4. sbit CE   = P0^0;  // Chip Enable pin signal (output)
  5. sbit CSN  = P0^1;  // Slave Select pin, (output to CSN, nRF24L01)
  6. sbit IRQ  = P0^5;  // Interrupt signal, from nRF24L01 (input)
  7. sbit MISO = P0^4;  // Master In, Slave Out pin (input)
  8. sbit MOSI = P0^3;  // Serial Clock pin, (output)
  9. sbit SCK  = P0^2;  // Master Out, Slave In pin (output)

  11. // SPI(nRF24L01) commands
  12. #define READ_REG    0x00  // Define read command to register
  13. #define WRITE_REG   0x20  // Define write command to register
  14. #define RD_RX_PLOAD 0x61  // Define RX payload register address
  15. #define WR_TX_PLOAD 0xA0  // Define TX payload register address
  16. #define FLUSH_TX    0xE1  // Define flush TX register command
  17. #define FLUSH_RX    0xE2  // Define flush RX register command
  18. #define REUSE_TX_PL 0xE3  // Define reuse TX payload register command
  19. #define NOP         0xFF  // Define No Operation, might be used to read status register

  21. // SPI(nRF24L01) registers(addresses)
  22. #define CONFIG      0x00  // 'Config' register address
  23. #define EN_AA       0x01  // 'Enable Auto Acknowledgment' register address
  24. #define EN_RXADDR   0x02  // 'Enabled RX addresses' register address
  25. #define SETUP_AW    0x03  // 'Setup address width' register address
  26. #define SETUP_RETR  0x04  // 'Setup Auto. Retrans' register address
  27. #define RF_CH       0x05  // 'RF channel' register address
  28. #define RF_SETUP    0x06  // 'RF setup' register address
  29. #define STATUS      0x07  // 'Status' register address
  30. #define OBSERVE_TX  0x08  // 'Observe TX' register address
  31. #define CD          0x09  // 'Carrier Detect' register address
  32. #define RX_ADDR_P0  0x0A  // 'RX address pipe0' register address
  33. #define RX_ADDR_P1  0x0B  // 'RX address pipe1' register address
  34. #define RX_ADDR_P2  0x0C  // 'RX address pipe2' register address
  35. #define RX_ADDR_P3  0x0D  // 'RX address pipe3' register address
  36. #define RX_ADDR_P4  0x0E  // 'RX address pipe4' register address
  37. #define RX_ADDR_P5  0x0F  // 'RX address pipe5' register address
  38. #define TX_ADDR     0x10  // 'TX address' register address
  39. #define RX_PW_P0    0x11  // 'RX payload width, pipe0' register address
  40. #define RX_PW_P1    0x12  // 'RX payload width, pipe1' register address
  41. #define RX_PW_P2    0x13  // 'RX payload width, pipe2' register address
  42. #define RX_PW_P3    0x14  // 'RX payload width, pipe3' register address
  43. #define RX_PW_P4    0x15  // 'RX payload width, pipe4' register address
  44. #define RX_PW_P5    0x16  // 'RX payload width, pipe5' register address
  45. #define FIFO_STATUS 0x17  // 'FIFO Status Register' register address
  46. #define TX_ADR_WIDTH   5  // 5字節(jié)寬度的發(fā)送/接收地址
  47. #define TX_PLOAD_WIDTH 4  // 數(shù)據(jù)通道有效數(shù)據(jù)寬度
  48. #define LED P1

  50. uchar code TX_ADDRESS[TX_ADR_WIDTH] = {0x34,0x43,0x10,0x10,0x01};  // 定義一個(gè)靜態(tài)發(fā)送地址
  51. uchar RX_BUF[TX_PLOAD_WIDTH];
  52. uchar TX_BUF[TX_PLOAD_WIDTH];
  53. uchar flag;
  54. uchar DATA = 0x01;
  55. uchar bdata sta;
  56. sbit  RX_DR = sta^6;
  57. sbit  TX_DS = sta^5;
  58. sbit  MAX_RT = sta^4;

  60. void init_io(void)
  61. {
  62. CE  = 0;        // 待機(jī)
  63. CSN = 1;        // SPI禁止
  64. SCK = 0;        // SPI時(shí)鐘置低
  65. IRQ = 1;        // 中斷復(fù)位
  66. LED = 0xff; // 關(guān)閉指示燈
  67. }

  69. void delay_ms(uchar x)
  70. {
  71.     uchar i, j;
  72.     i = 0;
  73.     for(i=0; i<x; i++)
  74.     {
  75.        j = 250;
  76.        while(--j);
  77.   j = 250;
  78.        while(--j);
  79.     }
  80. }

  82. uchar SPI_RW(uchar byte)
  83. {
  84. uchar i;
  85.     for(i=0; i<8; i++)          // 循環(huán)8次
  86.     {
  87.     MOSI = (byte & 0x80);   // byte最高位輸出到MOSI
  88.     byte <<= 1;             // 低一位移位到最高位
  89.     SCK = 1;                // 拉高SCK，nRF24L01從MOSI讀入1位數(shù)據(jù)，同時(shí)從MISO輸出1位數(shù)據(jù)
  90.     byte |= MISO;       // 讀MISO到byte最低位
  91.     SCK = 0;             // SCK置低
  92.     }
  93.     return(byte);           // 返回讀出的一字節(jié)
  94. }

  96. uchar SPI_RW_Reg(uchar reg, uchar value)
  97. {
  98. uchar status;
  99.   CSN = 0;                   // CSN置低，開始傳輸數(shù)據(jù)
  100.   status = SPI_RW(reg);      // 選擇寄存器，同時(shí)返回狀態(tài)字
  101.   SPI_RW(value);             // 然后寫數(shù)據(jù)到該寄存器
  102.   CSN = 1;                   // CSN拉高，結(jié)束數(shù)據(jù)傳輸
  103.   return(status);            // 返回狀態(tài)寄存器
  104. }

  106. uchar SPI_Read(uchar reg)
  107. {
  108. uchar reg_val;
  109.   CSN = 0;                    // CSN置低，開始傳輸數(shù)據(jù)
  110.   SPI_RW(reg);                // 選擇寄存器
  111.   reg_val = SPI_RW(0);        // 然后從該寄存器讀數(shù)據(jù)
  112.   CSN = 1;                    // CSN拉高，結(jié)束數(shù)據(jù)傳輸
  113.   return(reg_val);            // 返回寄存器數(shù)據(jù)
  114. }

  116. uchar SPI_Read_Buf(uchar reg, uchar * pBuf, uchar bytes)
  117. {
  118. uchar status, i;
  119.   CSN = 0;                    // CSN置低，開始傳輸數(shù)據(jù)
  120.   status = SPI_RW(reg);       // 選擇寄存器，同時(shí)返回狀態(tài)字
  121.   for(i=0; i<bytes; i++)
  122.     pBuf[i] = SPI_RW(0);    // 逐個(gè)字節(jié)從nRF24L01讀出
  123.   CSN = 1;                    // CSN拉高，結(jié)束數(shù)據(jù)傳輸
  124.   return(status);             // 返回狀態(tài)寄存器
  125. }

  127. uchar SPI_Write_Buf(uchar reg, uchar * pBuf, uchar bytes)
  128. {
  129. uchar status, i;
  130.   CSN = 0;                    // CSN置低，開始傳輸數(shù)據(jù)
  131.   status = SPI_RW(reg);       // 選擇寄存器，同時(shí)返回狀態(tài)字
  132.   for(i=0; i<bytes; i++)
  133.     SPI_RW(pBuf[i]);        // 逐個(gè)字節(jié)寫入nRF24L01
  134.   CSN = 1;                    // CSN拉高，結(jié)束數(shù)據(jù)傳輸
  135.   return(status);             // 返回狀態(tài)寄存器
  136. }

  138. void RX_Mode(void)
  139. {
  140. CE = 0;
  141.   SPI_Write_Buf(WRITE_REG + RX_ADDR_P0, TX_ADDRESS, TX_ADR_WIDTH);  // 接收設(shè)備接收通道0使用和發(fā)送設(shè)備相同的發(fā)送地址
  142.   SPI_RW_Reg(WRITE_REG + EN_AA, 0x01);               // 使能接收通道0自動(dòng)應(yīng)答
  143.   SPI_RW_Reg(WRITE_REG + EN_RXADDR, 0x01);           // 使能接收通道0
  144.   SPI_RW_Reg(WRITE_REG + RF_CH, 40);                 // 選擇射頻通道0x40
  145.   SPI_RW_Reg(WRITE_REG + RX_PW_P0, TX_PLOAD_WIDTH);  // 接收通道0選擇和發(fā)送通道相同有效數(shù)據(jù)寬度
  146.   SPI_RW_Reg(WRITE_REG + RF_SETUP, 0x07);            // 數(shù)據(jù)傳輸率1Mbps，發(fā)射功率0dBm，低噪聲放大器增益
  147.   SPI_RW_Reg(WRITE_REG + CONFIG, 0x0f);              // CRC使能，16位CRC校驗(yàn)，上電，接收模式
  148.   CE = 1;                                            // 拉高CE啟動(dòng)接收設(shè)備
  149. }

  151. void TX_Mode(uchar * BUF)
  152. {
  153. CE = 0;
  154.   SPI_Write_Buf(WRITE_REG + TX_ADDR, TX_ADDRESS, TX_ADR_WIDTH);     // 寫入發(fā)送地址
  155.   SPI_Write_Buf(WRITE_REG + RX_ADDR_P0, TX_ADDRESS, TX_ADR_WIDTH);  // 為了應(yīng)答接收設(shè)備，接收通道0地址和發(fā)送地址相同
  156.   SPI_Write_Buf(WR_TX_PLOAD, BUF, TX_PLOAD_WIDTH);                  // 寫數(shù)據(jù)包到TX FIFO
  157.   SPI_RW_Reg(WRITE_REG + EN_AA, 0x01);       // 使能接收通道0自動(dòng)應(yīng)答
  158.   SPI_RW_Reg(WRITE_REG + EN_RXADDR, 0x01);   // 使能接收通道0
  159.   SPI_RW_Reg(WRITE_REG + SETUP_RETR, 0x0a);  // 自動(dòng)重發(fā)延時(shí)等待250us+86us，自動(dòng)重發(fā)10次
  160.   SPI_RW_Reg(WRITE_REG + RF_CH, 40);         // 選擇射頻通道0x40
  161.   SPI_RW_Reg(WRITE_REG + RF_SETUP, 0x07);    // 數(shù)據(jù)傳輸率1Mbps，發(fā)射功率0dBm，低噪聲放大器增益
  162.   SPI_RW_Reg(WRITE_REG + CONFIG, 0x0e);      // CRC使能，16位CRC校驗(yàn)，上電
  163. CE = 1;
  164. }

  166. uchar Check_ACK(bit clear)
  167. {
  168. while(IRQ);
  169. sta = SPI_RW(NOP);                    // 返回狀態(tài)寄存器
  170. if(MAX_RT)
  171. if(clear)                         // 是否清除TX FIFO，沒有清除在復(fù)位MAX_RT中斷標(biāo)志后重發(fā)
  172. SPI_RW(FLUSH_TX);
  173. SPI_RW_Reg(WRITE_REG + STATUS, sta);  // 清除TX_DS或MAX_RT中斷標(biāo)志
  174. IRQ = 1;
  175. if(TX_DS)
  176. return(0x00);
  177. else
  178. return(0xff);
  179. }

  181. unsigned char nRF24L01_RxPacket(unsigned char* RX_BUF)
  182. {
  183.     unsigned char revale=0;

  185. //SetRX_Mode();

  187. sta=SPI_Read(STATUS); // read register STATUS's value
  188. if(RX_DR) // if receive data ready (RX_DR) interrupt
  189. {
  190.    CE = 0;
  191. SPI_Read_Buf(RD_RX_PLOAD,RX_BUF,TX_PLOAD_WIDTH);// read receive payload from RX_FIFO buffer
  192. revale =1;//we have receive data
  193. }
  194. SPI_RW_Reg(WRITE_REG+STATUS,sta);// clear RX_DR or TX_DS or MAX_RT interrupt flag
  195. return revale;
  196. }

  198. void main(void)
  199. {
  200. uchar i;
  201. uchar reveal;
  202. init_io();              // 初始化IO
  203. RX_Mode();              // 設(shè)置為接收模式
  204. while(1)
  205. {
  206. reveal=nRF24L01_RxPacket(RX_BUF);
  207. if(reveal==1)           // 接受完成
  208. {
  209. reveal = 0;
  210. for(i=0;i<5;i++)
  211. {      
  212. LED = RX_BUF[i];
  213. delay_ms(250);
  214. delay_ms(250);
  215. }  
  216. }
  217. }
  218. }
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5#
ID:400885 發(fā)表于 2018-9-21 10:53 | 只看該作者
  1. #include <reg51.h>
  2. #define uchar unsigned char
  3. #define uint unsigned int
  4. sbit CE   = P1^0;  // Chip Enable pin signal (output)
  5. sbit CSN  = P1^1;  // Slave Select pin, (output to CSN, nRF24L01)
  6. sbit IRQ  = P1^5;  // Interrupt signal, from nRF24L01 (input)
  7. sbit MISO = P1^4;  // Master In, Slave Out pin (input)
  8. sbit MOSI = P1^3;  // Serial Clock pin, (output)
  9. sbit SCK  = P1^2;  // Master Out, Slave In pin (output)
  10. // SPI(nRF24L01) commands
  11. #define READ_REG    0x00  // Define read command to register
  12. #define WRITE_REG   0x20  // Define write command to register
  13. #define RD_RX_PLOAD 0x61  // Define RX payload register address
  14. #define WR_TX_PLOAD 0xA0  // Define TX payload register address
  15. #define FLUSH_TX    0xE1  // Define flush TX register command
  16. #define FLUSH_RX    0xE2  // Define flush RX register command
  17. #define REUSE_TX_PL 0xE3  // Define reuse TX payload register command
  18. #define NOP         0xFF  // Define No Operation, might be used to read status register
  19. // SPI(nRF24L01) registers(addresses)
  20. #define CONFIG      0x00  // 'Config' register address
  21. #define EN_AA       0x01  // 'Enable Auto Acknowledgment' register address
  22. #define EN_RXADDR   0x02  // 'Enabled RX addresses' register address
  23. #define SETUP_AW    0x03  // 'Setup address width' register address
  24. #define SETUP_RETR  0x04  // 'Setup Auto. Retrans' register address
  25. #define RF_CH       0x05  // 'RF channel' register address
  26. #define RF_SETUP    0x06  // 'RF setup' register address
  27. #define STATUS      0x07  // 'Status' register address
  28. #define OBSERVE_TX  0x08  // 'Observe TX' register address
  29. #define CD          0x09  // 'Carrier Detect' register address
  30. #define RX_ADDR_P0  0x0A  // 'RX address pipe0' register address
  31. #define RX_ADDR_P1  0x0B  // 'RX address pipe1' register address
  32. #define RX_ADDR_P2  0x0C  // 'RX address pipe2' register address
  33. #define RX_ADDR_P3  0x0D  // 'RX address pipe3' register address
  34. #define RX_ADDR_P4  0x0E  // 'RX address pipe4' register address
  35. #define RX_ADDR_P5  0x0F  // 'RX address pipe5' register address
  36. #define TX_ADDR     0x10  // 'TX address' register address
  37. #define RX_PW_P0    0x11  // 'RX payload width, pipe0' register address
  38. #define RX_PW_P1    0x12  // 'RX payload width, pipe1' register address
  39. #define RX_PW_P2    0x13  // 'RX payload width, pipe2' register address
  40. #define RX_PW_P3    0x14  // 'RX payload width, pipe3' register address
  41. #define RX_PW_P4    0x15  // 'RX payload width, pipe4' register address
  42. #define RX_PW_P5    0x16  // 'RX payload width, pipe5' register address
  43. #define FIFO_STATUS 0x17  // 'FIFO Status Register' register address

  45. #define TX_ADR_WIDTH   5  // 5字節(jié)寬度的發(fā)送/接收地址
  46. #define TX_PLOAD_WIDTH 4  // 數(shù)據(jù)通道有效數(shù)據(jù)寬度
  47. uchar code TX_ADDRESS[TX_ADR_WIDTH] = {0x34,0x43,0x10,0x10,0x01};  // 定義一個(gè)靜態(tài)發(fā)送地址
  48. uchar RX_BUF[TX_PLOAD_WIDTH];
  49. uchar TX_BUF[TX_PLOAD_WIDTH];
  50. uchar flag;
  51. uchar DATA = 0x01;
  52. uchar bdata sta;
  53. sbit  RX_DR  = sta^6;
  54. sbit  TX_DS  = sta^5;
  55. sbit  MAX_RT = sta^4;

  57. void init_io(void)
  58. {
  59. CE  = 0;        // 待機(jī)
  60. CSN = 1;        // SPI禁止
  61. SCK = 0;        // SPI時(shí)鐘置低
  62. IRQ = 1;        // 中斷復(fù)位
  63. }

  65. void delay_ms(uchar x)
  66. {
  67.     uchar i, j;
  68.     i = 0;
  69.     for(i=0; i<x; i++)
  70.     {
  71.        j = 250;
  72.        while(--j);
  73.     j = 250;
  74.        while(--j);
  75.     }
  76. }

  78. uchar SPI_RW(uchar byte)
  79. {
  80. uchar i;
  81.     for(i=0; i<8; i++)          // 循環(huán)8次
  82.     {
  83.      MOSI = (byte & 0x80);   // byte最高位輸出到MOSI
  84.      byte <<= 1;             // 低一位移位到最高位
  85.      SCK = 1;                // 拉高SCK，nRF24L01從MOSI讀入1位數(shù)據(jù)，同時(shí)從MISO輸出1位數(shù)據(jù)
  86.      byte |= MISO;        // 讀MISO到byte最低位
  87.      SCK = 0;             // SCK置低
  88.     }
  89.     return(byte);            // 返回讀出的一字節(jié)
  90. }

  92. uchar SPI_RW_Reg(uchar reg, uchar value)
  93. {
  94. uchar status;
  95.    CSN = 0;                   // CSN置低，開始傳輸數(shù)據(jù)
  96.    status = SPI_RW(reg);      // 選擇寄存器，同時(shí)返回狀態(tài)字
  97.    SPI_RW(value);             // 然后寫數(shù)據(jù)到該寄存器
  98.    CSN = 1;                   // CSN拉高，結(jié)束數(shù)據(jù)傳輸
  99.    return(status);            // 返回狀態(tài)寄存器
  100. }

  102. uchar SPI_Read(uchar reg)
  103. {
  104. uchar reg_val;
  105.    CSN = 0;                    // CSN置低，開始傳輸數(shù)據(jù)
  106.    SPI_RW(reg);                // 選擇寄存器
  107.    reg_val = SPI_RW(0);        // 然后從該寄存器讀數(shù)據(jù)
  108.    CSN = 1;                    // CSN拉高，結(jié)束數(shù)據(jù)傳輸
  109.    return(reg_val);            // 返回寄存器數(shù)據(jù)
  110. }

  112. uchar SPI_Read_Buf(uchar reg, uchar * pBuf, uchar bytes)
  113. {
  114. uchar status, i;
  115.    CSN = 0;                    // CSN置低，開始傳輸數(shù)據(jù)
  116.    status = SPI_RW(reg);       // 選擇寄存器，同時(shí)返回狀態(tài)字
  117.    for(i=0; i<bytes; i++)
  118.      pBuf[i] = SPI_RW(0);    // 逐個(gè)字節(jié)從nRF24L01讀出
  119.    CSN = 1;                    // CSN拉高，結(jié)束數(shù)據(jù)傳輸
  120.    return(status);             // 返回狀態(tài)寄存器
  121. }

  123. uchar SPI_Write_Buf(uchar reg, uchar * pBuf, uchar bytes)
  124. {
  125. uchar status, i;
  126.    CSN = 0;                    // CSN置低，開始傳輸數(shù)據(jù)
  127.    status = SPI_RW(reg);       // 選擇寄存器，同時(shí)返回狀態(tài)字
  128.    for(i=0; i<bytes; i++)
  129.      SPI_RW(pBuf[i]);        // 逐個(gè)字節(jié)寫入nRF24L01
  130.    CSN = 1;                    // CSN拉高，結(jié)束數(shù)據(jù)傳輸
  131.    return(status);             // 返回狀態(tài)寄存器
  132. }

  134. void RX_Mode(void)
  135. {
  136. CE = 0;
  137.    SPI_Write_Buf(WRITE_REG + RX_ADDR_P0, TX_ADDRESS, TX_ADR_WIDTH);  // 接收設(shè)備接收通道0使用和發(fā)送設(shè)備相同的發(fā)送地址
  138.    SPI_RW_Reg(WRITE_REG + EN_AA, 0x01);               // 使能接收通道0自動(dòng)應(yīng)答
  139.    SPI_RW_Reg(WRITE_REG + EN_RXADDR, 0x01);           // 使能接收通道0
  140.    SPI_RW_Reg(WRITE_REG + RF_CH, 40);                 // 選擇射頻通道0x40
  141.    SPI_RW_Reg(WRITE_REG + RX_PW_P0, TX_PLOAD_WIDTH);  // 接收通道0選擇和發(fā)送通道相同有效數(shù)據(jù)寬度
  142.    SPI_RW_Reg(WRITE_REG + RF_SETUP, 0x07);            // 數(shù)據(jù)傳輸率1Mbps，發(fā)射功率0dBm，低噪聲放大器增益
  143.    SPI_RW_Reg(WRITE_REG + CONFIG, 0x0f);              // CRC使能，16位CRC校驗(yàn)，上電，接收模式
  144.    CE = 1;                                            // 拉高CE啟動(dòng)接收設(shè)備
  145. }

  147. void TX_Mode(uchar * BUF)
  148. {
  149. CE = 0;
  150.    SPI_Write_Buf(WRITE_REG + TX_ADDR, TX_ADDRESS, TX_ADR_WIDTH);     // 寫入發(fā)送地址
  151.    SPI_Write_Buf(WRITE_REG + RX_ADDR_P0, TX_ADDRESS, TX_ADR_WIDTH);  // 為了應(yīng)答接收設(shè)備，接收通道0地址和發(fā)送地址相同
  152.    SPI_Write_Buf(WR_TX_PLOAD, BUF, TX_PLOAD_WIDTH);                  // 寫數(shù)據(jù)包到TX FIFO
  153.    SPI_RW_Reg(WRITE_REG + EN_AA, 0x01);       // 使能接收通道0自動(dòng)應(yīng)答
  154.    SPI_RW_Reg(WRITE_REG + EN_RXADDR, 0x01);   // 使能接收通道0
  155.    SPI_RW_Reg(WRITE_REG + SETUP_RETR, 0x0a);  // 自動(dòng)重發(fā)延時(shí)等待250us+86us，自動(dòng)重發(fā)10次
  156.    SPI_RW_Reg(WRITE_REG + RF_CH, 40);         // 選擇射頻通道0x40
  157.    SPI_RW_Reg(WRITE_REG + RF_SETUP, 0x07);    // 數(shù)據(jù)傳輸率1Mbps，發(fā)射功率0dBm，低噪聲放大器增益
  158.    SPI_RW_Reg(WRITE_REG + CONFIG, 0x0e);      // CRC使能，16位CRC校驗(yàn)，上電
  159. CE = 1;
  160. }

  162. uchar Check_ACK(bit clear)
  163. {
  164. while(IRQ);
  165. sta = SPI_RW(NOP);                    // 返回狀態(tài)寄存器
  166. if(MAX_RT)
  167.   if(clear)                         // 是否清除TX FIFO，沒有清除在復(fù)位MAX_RT中斷標(biāo)志后重發(fā)
  168.    SPI_RW(FLUSH_TX);
  169. SPI_RW_Reg(WRITE_REG + STATUS, sta);  // 清除TX_DS或MAX_RT中斷標(biāo)志
  170. IRQ = 1;
  171. if(TX_DS)
  172.   return(0x00);
  173. else
  174.   return(0xff);
  175. }

  177. unsigned char nRF24L01_RxPacket(unsigned char* RX_BUF)
  178. {
  179.     unsigned char revale=0;
  180. //SetRX_Mode();
  181. sta=SPI_Read(STATUS); // read register STATUS's value
  182. if(RX_DR)    // if receive data ready (RX_DR) interrupt
  183. {
  184.      CE = 0;
  185.   SPI_Read_Buf(RD_RX_PLOAD,RX_BUF,TX_PLOAD_WIDTH);// read receive payload from RX_FIFO buffer
  186.   revale =1;//we have receive data
  187. }
  188. SPI_RW_Reg(WRITE_REG+STATUS,sta);// clear RX_DR or TX_DS or MAX_RT interrupt flag

  190. return revale;
  191. }

  193. void main(void)
  194. {
  195. uchar a[5]={0xfe,0xfd,0xfc,0xf0,0x1d};
  196. uchar i;
  197. init_io();                // 初始化IO
  198. // RX_Mode();                // 設(shè)置為接收模式
  199. while(1)
  200. {
  201.   for(i=0;i<5;i++)
  202.   {
  203.    TX_BUF[i] = a[i];          // 數(shù)據(jù)送到緩存
  204.    TX_Mode(TX_BUF);   // 把nRF24L01設(shè)置為發(fā)送模式并發(fā)送數(shù)據(jù)
  205.    Check_ACK(1);               // 等待發(fā)送完畢，清除TX FIFO
  206.    delay_ms(250);
  207.    delay_ms(250);
  208. // RX_Mode();
  209.   }  
  210. }
  211. }
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