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Altium Designer18基礎操作部分問題精心總結

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樓主
ID:470769 發表于 2019-1-20 09:18 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
參考網絡資料以及本人實踐的精心總結。不看就錯過了。
一、創建原理圖模版
   1.1、首先打開AD軟件,并創建新的原理圖,在右側屬性欄中,取消如下選項:
      1.2、繪制自定義的標題欄,并利用畫線工具、放置文本工具繪制標題欄,效果如下:
     標題欄中黑色字體是直接放置的文本,藍色字體是放置文本后,將文本指向AD自帶的關鍵字值。
         系統關鍵字有:
                a.“=Revision”:            原理圖版本號;
                b.“=Title”:                 原理圖名稱
                c.“=CurrentTime”:      當前系統時間
                d.“=CurrentDate”:      當前系統日期
                e.“=DocumentNum”: 原理圖文檔編號
                f.“=SheetNumber”:     當前文檔在工程中的編號
                g.“=SheetTotal”:         當前工程原理圖個數
                等等選項。
              
  1.3、繪制好標題欄后,將文件保存到模版存放的路徑:
       1.3.1、查詢本機模版文件存放路徑:
             依次點擊:工具->原理圖優選項 ,在彈出對話框中選擇:Data Management->Templates ,在右側查看當前模版文件存放位置。
        1.3.2、將自定義的原理圖另存為 *.SchDot文件,存儲路徑即上一步查找的模版位置,并命名為自己可辨識的模版名,建議用圖紙大小加英文命名。
1.4、使用自定義的模版文件,以下兩種使用方式任選一個均可:
1.4.1、設置軟件,新建原理圖時自動加載自定義的模版文件:
          依次點擊:工具->原理圖有選項,選擇Schematic下,General選擇默認打開模版,如圖:
1.4.2、新建原理圖后加載模版文件:
操作如下:
      依次點擊:設計 à 模版 à 通用模版 à 自定義模版文件名
      選擇后便可以自動加載自定義模版文件。
      具體操作參考下圖:
二、原理圖編譯問題
    2.1、自動編號出現標號重復問題
顯示元件如圖,隱隱有原標號,但是不管怎么自動編號,都不管用,這不是元器件編號時選項錯誤,只需要重新建個工程,錯誤原因:工程無法加載添加的原理圖的元器件信息,沒有和庫對應起來,重新建工程后便可解決,把原理圖拖進去即可。
2.2、原理圖繪制完成時,需要編譯原理圖檢查錯誤
2.3、編譯后出現告警信息:warning:Off grid ……解決辦法
       2.3.1、將元器件對其到柵格上
      2.3.2、元器件在對其柵格后依舊報off grid告警
      出現該情況時,需要重新繪制元件庫,在繪制元件時將Pin對其柵格:
三、生成PCB網表出現如下問題及解決辦法
當多次生成網表信息update到PCB文件中時,會出現網表信息出錯,以下是兩種錯誤情況,一個是unknown pin,另一個failed to add class member,這兩個問題可以用簡單粗暴的方式解決:刪除工程現有的PCB文件,重新建一個新的PCB到工程中,更徹底的方法是重新建立工程,把繪制好的原理圖添加到新的工程中重新來一遍即可。

3.1、出現錯誤Unknown Pin:xxx
錯誤如下圖:
       該問題的原因是在本工程中的PCB已經下載過一次元器件的連接網表信息,再次下載就會報錯,此時只需要將工程中PCB文件的網表信息全部清除即可,操作如下:
  3.2、出現錯誤failed to add class member:xxx
     錯誤如圖:
      該問題出現原因是由于多次重新update網表到PCB文件,導致PCB原有網表類信息與現update的信息相沖突,導致update失敗,解決辦法如下:
       第一步:查看工程中現有PCB文件的類信息:
      第二步:刪除PCB文件中的類信息,重新update網表信息到PCB中。
      該類在update時候也能看到添加信息,如下圖:
四、PCBupdate后不報錯,但是出現元器件無連接情況
如圖所示:
       該問題根源在于原理圖庫(lib)未嚴格繪制,導致原理圖模型和pcb的footprint對應關系混亂,從而使得pcb的update更新網表失敗,因此在繪制原理圖時需要注意以下問題,如圖是繪制引腳錯誤及正確的演示:
      以上圖片描述中,元器件繪制完成后,在編輯奇器件的引腳屬性時,注意屬性中的“Designator”和“Name”的屬性配置,這二者的配置需要注意其用途:“Designator”屬性用于原理圖模型和元器件的footprint對應關系設置使用,需要使該屬性的值為唯一,保證原理圖的引腳與其pcb的footprint對應且只一一對應;“Name”屬性用于表示該引腳的功能標號,如:VCC、GND、CLK、GPIO及EN等引腳功能的描述。
五、放置keepout layer實現PCB的外形切割以及板內開孔
  5.1、利用工具放置keepout layer,如下:
   5.2、利用工具實現板內空的挖空效果:
六、PCB設計規則頁簡述(有的地方理解不完全正確)
以上僅作參考,如有不足還請指正,共同學習共同進步,謝謝。

完整的Word格式文檔51黑下載地址:
Altium Design18.0.7基礎操作部分問題總結.docx (2.12 MB, 下載次數: 51)


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沙發
ID:727238 發表于 2020-4-13 21:40 | 只看該作者
感謝樓主分享!
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板凳
ID:337376 發表于 2020-4-15 11:14 | 只看該作者
感謝分享~很棒的入門材料
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地板
ID:150320 發表于 2024-12-16 13:43 | 只看該作者
樓主英武
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