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74HC74資料

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樓主
ID:425162 發表于 2018-11-12 17:39 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
1、74HC74是一款雙D觸發器(在一片上集成了2個D型觸發器)。它的作用是在CP(或CLK)引腳上出現上跳變的時刻,把D引腳上的電平記住(保存)在Q端。通過不同的接線,74HC74可以用來做分頻器,多位數字暫存器等。
2、觸發類型:D型
傳播延遲時間:14ns
頻率:76MHz
輸出電流:5.2mA
觸發類型:上升沿
電源電壓范圍:2V to 6V
針腳數:14
工作溫度范圍:-40°C to +125°C
電源電壓 最大:6V
電源電壓 最小:2V
輸入數:1
邏輯芯片功能:帶置位和復位的上升沿有效雙D觸發器
門電路數:2
74HC74是一個高速硅柵CMOS器件,其引腳與低功耗肖特基TTL兼容(輸入通道)。
該74HC74是雙正邊沿觸發,D型觸發器與(D)輸入,時鐘(CP)的輸入個人資料,集(SD)和復位(RD)的投入;也互補Q和非Q輸出。設定和復位是異步積極投入低并能獨立工作的時鐘輸入。信息輸入的數據傳送到Q輸出的低到高的時鐘脈沖過渡。D的投入必須是穩定的一個設定時間之前低到高,時鐘轉換為可預知的操作。施密特觸發器的時鐘輸入操作,使電路高度耐慢時鐘上升和下降時間。
 什么是74HC74
  74HC74是一款高速CMOS器件,74HC74引腳兼容低功耗肖特基TTL(LSTTL)系列。74HC74遵循JEDEC標準no.7A。
  74HC74是雙路D 型上升沿觸發器 ,帶獨立的數據(D)輸入、時鐘 (CP)輸入、設置(SD)和復位(RD)輸入、以及互補的Q和Q輸出。
  設置和復位為異步低電平有效,且不依賴于時鐘輸入。74HC74數據輸入口的信息在時鐘脈沖的上升沿傳輸到Q口。為了獲得預想中的結果,D輸入必須在時鐘脈沖上升沿來臨之前,保持穩定一段就緒時間。
  74HC74時鐘輸入的施密特觸發功能使得電路對于緩慢的脈沖上升和下降具備更高的容差性。
  74hc74應用電路原理圖
  如圖所示是由六反相器74HC04(F1 -F3)、雙上升沿D觸發器74HC74(F4~F11)以及四2輸入端或非門74HC02等組成的多頻率產生電路圖,該電路能按照需求產生多種頻率。
  
  圖 多頻率產生電路
  在電路圖中,反相器F2、F3與電阻R1、R2以及晶體SJL組合產生頻率為20MHZ的振蕩器、其中R1、R2將反相器F2、F3 偏置在線性澠圃內。該脈沖信號經F1反相后,傳輸到觸發器74HC74中進行分頻。
  根據2"分頻規律可知,當n=1時,進行二分頻,即在V1點輸出 10MHz(20÷2=10)的頻率;當n=2時,進行四分頻,即在V3點輸出 5MHz(20÷2'=5)的頻率;n為分頻同理。
  圖中,U1為雙路D觸發器74HC74,U5為單片UP監控芯片MAX706,J1繼電器控制高壓的閉合與斷開,J2繼電器控制液晶顯示器的掉電及上電。U1、U3、U3、U4等構成高壓擊穿復位電路,U5及外圍電路構成系統復位電路。此復位電路實現了上電復位和擊穿復位以及WATCHDOG功能。啟動時,P1.6為低電平,P1.4發出一負脈沖,則觸發器CD端也出現一段負脈沖。此時Q=L,J1高壓斷電器閉合,高壓接通。當高壓擊穿時,GYXH端為低電平,或者當電機正轉到滿足位時,P1.6變為高是電平,則觸發器SD=L,Q=H,高壓控制繼電器切斷,同時U4的輸出產生一個高電平脈沖。高電平寬度由時間常數T=C3R2決定,在U4輸出高電平期間,J2動作,其常閉接點斷開,切斷液晶屏供電電源。經時間T后,U4輸出低電平,液晶屏供電正常。
  
  我用74hc74做的一個脈沖電平翻轉,當單片機輸出脈沖的上升沿到74HC74的CLK端時輸出翻轉,,,正常上電使用中功能都正常,默認上的74HC74會檢測到一個脈沖,然后輸出為高電平,當使用中時候出現一個短時間的掉電后有恢復上電,掉電時間小于10s時,此時上電74hc74的輸出電平保持掉電前的狀態,這樣就會導致如果在輸出狀態與默認狀態相反時,短暫掉電就會引起設備跳動,導致設備上電狀態可能會不一樣,不知道應該怎么解決!!
  電路如下所示,cp為負脈沖輸入信號,control為輸出信號
  

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沙發
ID:284667 發表于 2019-3-30 20:18 | 只看該作者
還不錯,樓主辛苦了,只不過我看不了圖片
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